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Re: 为什么多数reset信号都是低电平有效，而不是高电平？(1)
2004-07-19 原帖已删除|2004-07-19 flysig
Re: verilog中如何读入字符串数组？(0)
2004-07-18 原帖已删除|2004-07-18 mrqlee
Re: 请教熟悉DIVA的大虾(0)
2004-07-18 原帖已删除|2004-07-18 Toka
Re: [请教]如何做一个hard macro？(0)
2004-07-17 原帖已删除|2004-07-17 parachute
Re: 有谁用过SpartanIII的FPGA啊？请问... (转载)(0)
2004-07-17 原帖已删除|2004-07-17 flytian
Re: 推荐一些DC这种工具使用的Mailing list吧(0)
2004-07-16 原帖已删除|2004-07-16 philewar
Re: 关于综合的一个小问题(0)
2004-07-16 原帖已删除|2004-07-16 cloudyin
IC5在RedHat9上的安装(1)
2004-07-15 lijiayi|2004-07-16 mote
Re: 请问Hspice里面怎么只打印。。。。。(0)
2004-07-16 原帖已删除|2004-07-16 albred
Re: Give me an answer .(0)
2004-07-15 原帖已删除|2004-07-15 liuyudong
Re: 请问FPGA的时钟专用管脚和普通I/O？(0)
2004-07-15 原帖已删除|2004-07-15 skya
Re: 问一个se读入gcf的问题(0)
2004-07-15 原帖已删除|2004-07-15 philewar
Re: 求教hspice里如何保存所有支路上的电流(0)
2004-07-15 原帖已删除|2004-07-15 Liux100
Re: 特征线宽越小，IC工作速度越快？？(1)
2004-07-15 原帖已删除|2004-07-15 hjackchen
Re: 麻烦大侠看看IC5.0装好后的这个warning(0)
2004-07-15 原帖已删除|2004-07-15 gftw
Re: nanosim VCS仿真问题(0)
2004-07-14 原帖已删除|2004-07-14 mullich
Re: 怎么把gdsII导进cadence环境里亚？(0)
2004-07-14 原帖已删除|2004-07-14 dafaa
Re: Altera的Nios是个什么东西啊？(0)
2004-07-14 原帖已删除|2004-07-14 crownadam
Re: 大家给几个能下载到Verilog Sourcecode的站点吧(1)
2004-07-14 原帖已删除|2004-07-14 bestyang0
IC封装趋势的当前挑战(0)
2004-07-14 zhaohb03|2004-07-14 zhaohb03
Re: 请问什么叫shadow register(影子寄存器)?(0)
2004-07-13 原帖已删除|2004-07-13 hanzy
Re: 电感Q值多少是合理？TSMC 0.25um process(0)
2004-07-13 原帖已删除|2004-07-13 leeart
Re: 请问什么书讲运算跨导放大器(OTA)比较多？(0)
2004-07-13 原帖已删除|2004-07-13 cdy
Re: DC中的Design Time和PrimeTime的区别？(1)
2004-07-13 原帖已删除|2004-07-13 parachute
SKILL 写pcell的问题(1)
2004-07-10 sring|2004-07-12 zgki
中美解决芯片退税贸易争端，双方反应不一(0)
2004-07-12 dtl|2004-07-12 dtl
Re: 用过calibre的大虾帮忙看一下这个问题(0)
2004-07-12 原帖已删除|2004-07-12 mgclily
Re: 请问在Verilog里如何将模块的输出存储到指定的文件中？(1)
2004-07-12 原帖已删除|2004-07-12 tonnie
Re: 急问max－plus 2的一个问题。(0)
2004-07-11 原帖已删除|2004-07-11 ysmiling
Re: 请问wlan标准(1)
2004-07-11 原帖已删除|2004-07-11 jfet

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