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Re: 请教一个FPGA的问题 (转载)(0)
2007-05-21 原帖已删除|2007-05-21 newbeesile
Re: altera器件命名含义是什么？(0)
2007-05-20 原帖已删除|2007-05-20 FabioCapello
Re: 请看看这VHDL的代码(0)
2007-05-18 原帖已删除|2007-05-18 frankrick
Re: 请教如何减少时钟的扇出(0)
2007-05-17 原帖已删除|2007-05-17 redsun
VHDL书(3)
2007-05-07 Cybersailor|2007-05-07 Cybersailor
Re: 如何消除毛刺？(0)
2007-05-04 原帖已删除|2007-05-04 redsun
提升FPGA协处理器加速性能，XtremeData深受Stratix III吸引zz ((0)
2007-04-23 oBigeyes|2007-04-23 oBigeyes
Re: 如何编译xilinx ISE7.1的库(0)
2007-04-23 原帖已删除|2007-04-23 newbeesile
[合集] 销售信息！！！(0)
2007-04-13 cind|2007-04-13 cind
发个自己写的arm cpu core给大家看看，觉得好玩就顶一下(0)
2007-03-29 bupabupa|2007-03-29 bupabupa
Re: SDRAM：采取自动Precharge时（A10置高方式），它究竟什么时(1)
2007-03-27 原帖已删除|2007-03-27 frankrick
Re: mpeg-2的解码过程需要的时钟为何是27mhz的呢？(1)
2007-03-27 原帖已删除|2007-03-27 featured
Re: 问两个关于xilinx FPGA的两个初级问题？(0)
2007-03-27 原帖已删除|2007-03-27 InterRonaldo
Re: 想让复位信号持续几个周期怎么办？(0)
2007-03-27 原帖已删除|2007-03-27 feitengyu
Re: 弱问:有三态与门么? 在FPGA里可实现么?(0)
2007-03-26 原帖已删除|2007-03-26 frankrick
Re: 等待一个信号变化应该怎么写？(0)
2007-03-24 原帖已删除|2007-03-24 lijiangshui
Re: 请教一下使用PLL的跨时域设计(0)
2007-03-23 原帖已删除|2007-03-23 flyingcowboy
Re: 哪里能下到VHDL的标准？(0)
2007-03-22 原帖已删除|2007-03-22 i8O86
Re: 有关FPGA的资源使用问题(0)
2007-03-22 原帖已删除|2007-03-22 staryi
Re: 请问ALTERA Byteblaster II的问题(0)
2007-03-20 原帖已删除|2007-03-20 catworm
Re: 还有一个关于综合的问题(2)
2007-03-19 原帖已删除|2007-03-19 frankrick
关于rom和LUT的问题(4)
2007-03-19 simpleboy|2007-03-19 newbeesile
Re: 在综合布局布线上有些不太清楚(1)
2007-03-18 原帖已删除|2007-03-18 frankrick
Re: 请问什么是“组合环“？(0)
2007-02-13 原帖已删除|2007-02-13 frankrick
Re: 关于chipscope的问题(1)
2007-02-06 原帖已删除|2007-02-06 grassleaf
总结下设计时估计Altera公司FPGA最大功耗办法(0)
2007-01-30 snowcharm|2007-01-30 snowcharm
Re: 想在FPGA里做一个函数，实现一些图形，该从哪里着手？(0)
2007-01-19 原帖已删除|2007-01-19 bamrest
[公告] 任命 cind 为 FPGATech/可编程器件技术版版主 (转载)(0)
2007-01-13 SYSOP|2007-01-13 SYSOP
关于VHDL和Verilog的区别的一点心得，一家之言……(0)
2007-01-11 intermilan00|2007-01-11 intermilan00
Re: 有没有fpga内嵌ad的？(0)
2007-01-06 原帖已删除|2007-01-06 Zipper