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bit/mcs文件的格式都是什么样的？(5)
2010-10-08 gahang|2010-10-09 neman
pad-to-pad delay constraint(7)
2010-10-08 BourneJason|2010-10-08 Package
Quartus最大支持几个CPU？(2)
2010-10-08 O08|2010-10-08 VidaMMX
Xilinx ISE Design Suite 12.3 – 现已面市!(1)
2010-10-08 Package|2010-10-08 Immajia
支持I2C总线的芯片与支持CAN总线的芯片之间如何转换(0)
2010-10-08 mynewday|2010-10-08 mynewday
锁相环输出可以直接引到全局时钟io管脚上进行输出吗？(3)
2010-10-06 majiawang|2010-10-07 Jarod
Cylone II的行IO和列IO有什么区别？(0)
2010-10-07 ctrainr|2010-10-07 ctrainr
[新手请教]FPGA器件管脚的这些模型是什么意思？（与ibis模型有(0)
2010-10-07 bbdlp|2010-10-07 bbdlp
以前经常嫌quartus编译慢(4)
2010-09-30 Pinder|2010-10-07 imlaohe
请问cyclone iii里面SRAM支持的最大频率(4)
2010-10-03 mutourencn|2010-10-06 Package
ise中为什么我加的锁相环一直有？号(0)
2010-10-06 wwhll|2010-10-06 wwhll
xilinx virtex5 BPI Flash的型号是不是有限制？(5)
2010-09-30 nba23|2010-10-06 InterRonaldo
请问Altera FPGA怎么导出仿真数据？(1)
2010-09-24 vidivici|2010-10-05 pearman
请教quartus9.1的问题(15)
2010-09-25 Boge|2010-10-05 pearman
哪里能搞到A家4代的器件(2)
2010-10-02 O08|2010-10-05 pearman
ise下modelsim的仿真问题(1)
2010-10-03 wwhll|2010-10-04 icestones
请教关于ddr2的差分DQS/DQSn(4)
2010-10-01 lins05|2010-10-04 Bonaparte
EP3C25Q240在配置EPCS16时候的问题疑问(7)
2010-09-30 feitengyu|2010-10-01 ADCs
用哪种FPGA将PCI上的每笔数据用LED显示比较好？(4)
2010-09-30 goinking|2010-10-01 BLC
原来Stratix II里面ddr2每个vref管脚最多驱动20个output..(8)
2010-09-30 lins05|2010-09-30 heartfield
modelsim中Xilinx仿真库的问题(0)
2010-09-30 havefun94|2010-09-30 havefun94
计算机的串口和FPGA的串口之间要经过电平转换吗？(15)
2010-09-28 mynewday|2010-09-30 iProxy
xilinx好无聊啊(8)
2010-09-29 i8086|2010-09-29 imlaohe
从计算机向串口发数据，串口可以保存数据吗？还是要从串口把数(10)
2010-09-28 mynewday|2010-09-29 katyusza
FPGA芯片去耦电容的封装和布局是怎样？ (转载)(2)
2010-09-29 report|2010-09-29 kissGNU
有fpga+dsp的开发板吗？(2)
2010-09-27 chshch|2010-09-29 spadger
请教QII安装的时候是不是可以去掉那个64位的support？(9)
2010-09-28 sdew|2010-09-29 maoxia
高速产生信号波形,同时通过串口传入计算机,可以吗?(24)
2010-09-25 mynewday|2010-09-28 BLC
cyclone iii外部有5V的信号，应该如何设置才能兼容？(2)
2010-09-27 zhaohb03|2010-09-28 xiaorensu
FPGA电路和计算机之间高速传数据,除了串口外还有什么更好的办法(6)
2010-09-28 mynewday|2010-09-28 wswwater