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Re: 在verilog中如何在其他模块里面调用task?
1553 2008-06-12 i8086
● altera中有带光口的开发板吗？
1552 2008-06-12 PhysX
Re: 在verilog中如何在其他模块里面调用task?
1551 2008-06-12 superdsp
Re: 在verilog中如何在其他模块里面调用task?
1550 2008-06-12 superdsp
Re: SUNDesign——FPGA设计要点
1549 2008-06-12 superdsp
● 高手讲一讲SYSTEMC 和 SYSTEMVERILOG的发展趋势
1548 2008-06-12 superdsp
Re: 这种情况该怎么加约束？
1547 2008-06-12 hutcoffee
Re: 这种情况该怎么加约束？
1546 2008-06-12 nel
● 这种情况该怎么加约束？
1545 2008-06-12 hutcoffee
Re: altera的ram分配问题
1544 2008-06-12 O08
● 如何提高综合速度？使用ieee_proposed packages
1543 2008-06-12 parv
Re: altera的ram分配问题
1542 2008-06-12 chenpp
Re: 请问FLEX10K10是CPLD还是FPGA
1541 2008-06-11 tjromaprince
Re: altera的ram分配问题
1540 2008-06-11 BLC
Re: altera的ram分配问题
1539 2008-06-11 oBigeyes
● 请问FLEX10K10是CPLD还是FPGA
1538 2008-06-11 Boge
Re: altera的ram分配问题
1537 2008-06-11 daviesja
Re: altera的ram分配问题
1536 2008-06-11 pensi
Re: altera的ram分配问题
1535 2008-06-11 BLC
● altera的ram分配问题
1534 2008-06-11 O08
Re: 关于ISE 8.2i 与 ISE 7.1i 综合的问题
1533 2008-06-11 zhs01
Re: 关于ISE 8.2i 与 ISE 7.1i 综合的问题
1532 2008-06-11 acceler
Re: verilog中for循环弱问
1531 2008-06-11 tjromaprince
Re: 关于ISE 8.2i 与 ISE 7.1i 综合的问题
1530 2008-06-11 feitengyu
Re: verilog中for循环弱问
1529 2008-06-11 hiticeberg
Re: verilog中for循环弱问
1528 2008-06-10 landice
Re: verilog中for循环弱问
1527 2008-06-10 nel
Re: verilog中for循环弱问
1526 2008-06-10 nel
Re: verilog中for循环弱问
1525 2008-06-10 tjromaprince
Re: verilog中for循环弱问
1524 2008-06-10 nel

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