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同主题|文摘|保留

● 双向端口仿真求教
3056 2008-08-26 sonneson
Re: ISE好烂
3055 2008-08-26 Jarod
Re: synplify 和 xst 综合结果在资源上差好多啊
3054 2008-08-26 Jarod
● 怎么进行混合编程啊
3053 2008-08-26 sonneson
Re: ISE好烂
3052 2008-08-26 hutcoffee
Re: 请问采样经过fifo读到pc中为何出错？
3051 2008-08-26 asfl
Re: 请问采样经过fifo读到pc中为何出错？
3050 2008-08-26 BLC
Re: ISE好烂
3049 2008-08-26 BLC
● 为什么Verilog中将一个端口删去仿真就错
3048 2008-08-26 davywb
Re: 打算选用synplify了
3047 2008-08-26 BLC
Re: 打算选用synplify了
3046 2008-08-26 i8086
Re: 打算选用synplify了
3045 2008-08-26 BourneJason
Re: 请问采样经过fifo读到pc中为何出错？
3044 2008-08-26 BourneJason
Re: 打算选用synplify了
3043 2008-08-26 i8086
● 打算选用synplify了
3042 2008-08-26 i8086
Re: 请问采样经过fifo读到pc中为何出错？
3041 2008-08-26 asfl
Re: VHDL的一个错误提示
3040 2008-08-26 ArnoldChow
Re: VHDL的一个错误提示
3039 2008-08-26 staryi
● VHDL的一个错误提示
3038 2008-08-26 ArnoldChow
Re: 请问，芯片最高工作频率的含义
3037 2008-08-26 BourneJason
Re: 请教
3036 2008-08-26 BourneJason
Re: 请问采样经过fifo读到pc中为何出错？
3035 2008-08-26 BourneJason
Re: 请教关于ISE和EDK安装的问题
3034 2008-08-26 BourneJason
Re: 求助！！VHDL编程错误
3033 2008-08-26 BourneJason
Re: synplify 和 xst 综合结果在资源上差好多啊
3032 2008-08-26 BourneJason
Re: ISE好烂
3031 2008-08-26 hutcoffee
Re: synplify 和 xst 综合结果在资源上差好多啊
3030 2008-08-26 Jarod
● 请问采样经过fifo读到pc中为何出错？
3029 2008-08-26 asfl
Re: synplify 和 xst 综合结果在资源上差好多啊
3028 2008-08-26 BourneJason
Re: 状态机中使用的变量的初始化在哪里进行?
3027 2008-08-26 BourneJason

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